Re: [閒聊] 震撼!Intel 18A 良率達到99%+
看板PC_Shopping (個人電腦購買)作者a000000000 (比古A十郎)時間1月前 (2024/12/08 01:18)推噓125(127推 2噓 102→)留言231則, 138人參與討論串2/3 (看更多)
※ 引述《oopFoo (3d)》之銘言:
: 今年8月 18A的D0<0.4的時候,良率就超過99%了。
: Dr. Ian Cutress在twitter po的圖
: https://i.imgur.com/is8kB82.jpeg
: 是的,2.25mm2的chip。這跟gg喜歡玩sram的良率是一樣的意思。
: https://i.imgur.com/V8AdS1q.jpeg
: 良率這種東西,本來就是越大顆良率越低,所以業界普通是用defect density(D0)來溝通的。
: 昨天,n2號稱6成良率,那6成的什麼東西?
: https://ec.ltn.com.tw/article/paper/1680811
: 普通來講,是手機晶片尺寸,那就是100mm2。D0大概就是0.4。
: 量產的時候D0<0.1才可以,那樣100mm2的良率才能夠達到90%以上。
: 0.4到0.1普通來講要一年,所以n2大概跟n3一樣要12/31日量產。
: 所以明年蘋果手機不用n2的新聞才傳出來。
: 18A時程早n2半年是沒問題的。問題是性能,價錢,產能,其它...
挖幹
大大尼這葛外行裝內行的程度還挺屌der
我在卒業寫生之旅還被人摳上來回尼這篇
我直接說惹
業界沒有人晶片良率看defect density
良率只看功能正不正常 效能正不正常
defect跟良率不是無關
不直接相關
一般情況要紙面上提升良率
那就把期待的效能區間放寬
良率就上來惹
不過功能不正常的還是不能用
例如預期1+1=2但是跑出來1+1=3之類der
功能問題通常4報錯比較多
初始良率不佳
常見的原因不少
不過在近代先進製程上
同片wafer不同位置電晶體特性都可以差不少惹
我印象中其中原因有時跟光學問題有關
光改善這94大學問惹
hen多人最近問我G叔下台的問題
其實泥各位看他這三四年
重大戰略失誤就一大堆惹
21年大幅度擴張->22年市場局勢反轉
掛惹gpu跟raja->錯失ai大浪潮 連葛邊都沒摸到
跟蘇媽在pc價格戰->搞到自己虧錢
我隨便想想就好幾種惹
董事會願意讓他體面退休
算夠意思惹
ceo下台常常代表重大戰略轉折
但是董事會還是跟G叔一樣想保晶圓廠
那就差不多回到原點
牙膏缺乏代工經驗
其實GG這十年的強勢週期
根本原因是抱上阿婆這條大腿
因為阿婆夠機掰+輪班星人夠奴
一拍即合
或者說這是目前人類社會想得到的最強的大型企業合作結構
至於阿婆的雞掰跟輪班星人的奴
我在裡面看惹十年 有機會再聊惹
牙膏想保晶圓廠4注定失敗der
因為沒有夠大顆又夠雞掰的大腿
自己的員工連奴字都不知道怎摸寫
大包小包整天推責任 這種被阿婆踢出供應鏈很正常
阿婆自己也吃過牙膏人文化的虧 例如那葛多拖惹幾年的modem
至於阿婆明年手機n3不是n2
我看惹只想說
哩洗勒供三小
阿婆n3用三年
三年前就決定惹好嗎
= =
--
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