[情報] AM5 CPU和晶片組之間的PCI-E通道分析

看板PC_Shopping (個人電腦購買)作者 (8C16T)時間3年前 (2022/06/08 14:43), 3年前編輯推噓10(11129)
留言41則, 15人參與, 3年前最新討論串1/2 (看更多)
講解 AM5 CPU 連接到 X670 晶片組的一些情報 圖片可以到來源網址觀看 ---------------------------------------------------------------- 這篇展示筆者猜想的 AMD AM5 CPU 連接 X670 晶片組之間的設計,並嘗試與 INTEL ALDER LAKE 12 代 CPU 連接 Z690 晶片組的做法,以及 AMD 自家上代 X570 的做法作比 較,同樣不必理會排序 / 排列。 AMD AM5 CPU 連接 X670 晶片組之 PCI-E 通道設計淺析 INTEL ALDER LAKE CPU 內建 PCI-E 4.0 X8 專門連接晶片組 Z690,而 X670 晶片組同時 支援 PCI-E 4.0 X8 作為其上行鏈結 (UPLINK),最終擴展出 28 條 PCI-E 3.0 + PCI-E 4.0 (以及 USB)。 這裡筆者先展示 X570 的做法。 AMD ZEN3 CPU 例如 RYZEN 3000 & RYZEN 5000 均內建 PCI-E 4.0 X4 專門用以連接 X570 晶片組。X570 晶片組同時以 PCI-E 4.0 X4 作上行鏈結,最終擴展出共 16 條 PCI-E 4.0 通道 (以及 SATA 和 USB 等等)。 來到 AM5 X670,情況有點特別。 以上的展示這是不對的,因為實際上 X670 以雙晶片組串連起來,上圖只是將兩顆內能用 的 PCI-E 通道放在一起,裝成一顆不會在 X670 上看得到的晶片組設計。 這裡有幾個重點: AM5 CPU 用以連接晶片通的通道是 GEN5 PCI-E X4,比 INTEL 少了 X4 但 INTEL 只是 PCI-E 4.0。AM5 CPU PCI-E 5.0 X4 VS. ALDER LAKE PCI-E 4.0 X8。 X670 雙晶片組的設計,那兩顆是一模一樣的 B650 晶片組。 B650 原生的上行鏈結是 PCI-E 4.0 而不是 5.0,所以最終會以 4.0 為依歸。 受制於串連晶片組的做法,第一顆 B650 即直接與 CPU 對接的那一顆 B650,須以其中 的 PCI-E 4.0 X4 用作下行鏈結 (DOWNLINK),接至第二顆 B650 晶片組而非其他 PCI-E 設備例如 PCI-E 插槽 / M.2 插槽等等。 B650 或 B650E 主機板,將只有一顆完整的 B650,將上圖的中間部份刪去則可,因為不 再需要晶片組分出部份 PCI-E 通道作下行鏈結至另一晶片組。 有別於部份 X570 主機板以 X570 晶片組內的 PCI-E 4.0 通道接出 PCI-E 3.0 插槽,筆 者認為這裡的 B650 晶片組非不為也實不能支援 PCI-E 5.0 X4 作上行鏈結。 AMD 在 COMPUTEX 2022 期間多次接受外媒訪問,當中提到 AMD 希望將主機板的成本壓下 來。姑且先不論 AMD 所說虛實,板廠絕對不是吃素的,除了技嘉。 技嘉已經透過外媒公佈其 X670 售價將會極為接近上代同款型號的定價,甚至更便宜。當 然箇中手法不見得是加量不加價 (與對手同級用料相比)。 近日筆者亦收一些消息,各板廠將微調主機板的規格和用料,最終規格和售價仍有一定變 數。若最終 X670 主機板售價不高於上代同款型號售價,只能歸功於技嘉造福全人類了。 來源:https://unikoshardware.com/2022/06/amd-am5-cpu-x670-pci-e-lanes.html -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 218.173.15.247 (臺灣) ※ 文章網址: https://www.ptt.cc/bbs/PC_Shopping/M.1654670582.A.836.html

06/08 14:50, 3年前 , 1F
頻寬少Z690一半還多串一顆 會卡嗎
06/08 14:50, 1F

06/08 15:14, 3年前 , 2F
接在最下游的延遲不知道會不會井噴
06/08 15:14, 2F

06/08 15:43, 3年前 , 3F
問個笨問題:既然現在CPU都是透過
06/08 15:43, 3F

06/08 15:43, 3年前 , 4F
PCIE到南橋,那是不是意味著南橋只是
06/08 15:43, 4F

06/08 15:44, 3年前 , 5F
個PCIE hub,那Intel跟AMD的南橋
06/08 15:44, 5F

06/08 15:44, 3年前 , 6F
可以交換用才對吧?
06/08 15:44, 6F

06/08 15:50, 3年前 , 7F
要轉可以 至少內文要校對吧 純噓X69
06/08 15:50, 7F

06/08 15:50, 3年前 , 8F
0
06/08 15:50, 8F
※ 編輯: evilhito (218.173.15.247 臺灣), 06/08/2022 16:15:52

06/08 16:18, 3年前 , 9F
文章寫得有點饒舌 救命一一
06/08 16:18, 9F

06/08 16:25, 3年前 , 10F
不懂為什摸寫這摸複雜
06/08 16:25, 10F

06/08 16:27, 3年前 , 11F
不就X670=兩顆B650
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06/08 16:27, 3年前 , 12F
然後B650 Uplink是PCIe 4.0
06/08 16:27, 12F

06/08 16:32, 3年前 , 13F
CPU→PCIe 4.0→B650
06/08 16:32, 13F

06/08 16:32, 3年前 , 14F
→PCIe 4.0 x4→B650
06/08 16:32, 14F

06/08 17:21, 3年前 , 15F
整篇文章前提就有可能是錯的,目前
06/08 17:21, 15F

06/08 17:21, 3年前 , 16F
AMD也沒有說X670E用的是兩顆B650晶
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06/08 17:21, 3年前 , 17F
片啊
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06/08 17:47, 3年前 , 18F
雙B650就是公開的秘密了 沒什麼好
06/08 17:47, 18F

06/08 17:48, 3年前 , 19F
不是的
06/08 17:48, 19F

06/08 17:56, 3年前 , 20F
computex 展出的不就是雙B650嗎
06/08 17:56, 20F

06/08 18:12, 3年前 , 21F
所以等x770完整版的意思嗎
06/08 18:12, 21F

06/08 18:14, 3年前 , 22F
除了技嘉 XD
06/08 18:14, 22F

06/08 20:56, 3年前 , 23F
架構大改第一代不要買 這是常識了
06/08 20:56, 23F

06/08 20:56, 3年前 , 24F
06/08 20:56, 24F

06/08 23:54, 3年前 , 25F
所以CPU接2個南橋會用掉2個PCIeGen
06/08 23:54, 25F

06/08 23:54, 3年前 , 26F
4 X4, 然後只留1個PCIeGen4 X4給M2
06/08 23:54, 26F

06/08 23:54, 3年前 , 27F
總計AM5 CPU Lane為
06/08 23:54, 27F

06/08 23:54, 3年前 , 28F
1XPCIeGen5 X16。
06/08 23:54, 28F

06/08 23:54, 3年前 , 29F
1XPCIeGen4 X12。
06/08 23:54, 29F

06/09 00:00, 3年前 , 30F
規格跟ALDER LAKE一模一樣
06/09 00:00, 30F

06/09 01:14, 3年前 , 31F
你之前也說TR PRO的八通道是假的
06/09 01:14, 31F

06/09 01:14, 3年前 , 32F
結果TR PRO真的給八通道
06/09 01:14, 32F

06/09 01:17, 3年前 , 33F

06/09 01:17, 3年前 , 34F
也別忘了 你之前吹intel通道怎樣
06/09 01:17, 34F

06/09 01:17, 3年前 , 35F
結果intel也沒有實際推過
06/09 01:17, 35F

06/09 01:17, 3年前 , 36F
intel的彈性IO在哪裡
06/09 01:17, 36F

06/09 01:17, 3年前 , 37F
我就問你這個問題而已
06/09 01:17, 37F

06/09 02:43, 3年前 , 38F
這2個ID是同個人唷!!
06/09 02:43, 38F

06/09 16:36, 3年前 , 39F
某推文閱讀能力堪慮,都說是 daisy-
06/09 16:36, 39F

06/09 16:36, 3年前 , 40F
chain 了還在 CPU 接兩個南橋
06/09 16:36, 40F

06/09 21:58, 3年前 , 41F
某家又再亂講,都說B650接B650惹
06/09 21:58, 41F
文章代碼(AID): #1Ye4JsWs (PC_Shopping)
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