[問題] Verilog的$random [(seed)]
如題...
最近剛學verilog看到$random [(seed)] <---這個解釋是
a 32-bit random number of signed integer
意思是說有2的32次方個數值嗎?
假設
always #5 Y= $random%60; \\有限制，隨機在-59~59間產生數據輸出
這邊我也不太懂...? 如果今天隨機輸出的值是32 那換成表示是2bit 10000
那在時序圖上的表示是如何呢?
因為在時序圖上只能看到high low這樣的脈波阿...
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※ 發信站: 批踢踢實業坊(ptt.cc)
◆ From: 140.124.134.12
推
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07/24 20:30, 1F
這個我瞭解 只是我的意思是說當我輸入%60時 會跑-59~59
所以最大值就是%2^32 這個數值對嗎?
那如果我#5 5ns後動作那個Y= $random%60 有什麼意義...
因為在時序圖上5ns動作後 假設隨機值是32那
5ns到10ns間這個值是多少?......看時序圖 也只有high low 這樣
看不出他的值 那如果只有high low...那為什麼要設60?
而不假設%1 就好 同樣都只有high low不是嗎@@?
※ 編輯: kid0368 來自: 140.124.134.12 (07/24 20:38)
假設說今天F = X&Y
Text bench中設定
always #5 X=$random%60
always #5 Y=$random%60
再假設X隨機值16 Y隨機值15
那F會變成什麼??.... 謝謝= ="
※ 編輯: kid0368 來自: 140.124.134.12 (07/24 20:43)
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