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[情報] JEDEC完成LPDDR6規範制定

看板PC_Shopping (個人電腦購買)作者 (ilinker)時間6小時前 (2025/07/17 21:14), 6小時前編輯推噓3(3推 0噓 20→)
留言23則, 8人參與, 3小時前最新討論串1/1
https://www.jedec.org/sites/default/files/Brett%20Murdock_FINAL_Mobile_2024.pdf https://www.jedec.org/news/pressreleases/jedec%C2%AE-releases-new-lpddr6-standard-enhance-mobile-and-ai-memory-performance https://tinyurl.com/mr8z9s43 資料傳輸數據為10667MT/s和14400MT/s，有效頻寬約相當於28.5GB/s ~ 38.4GB/s 性能部分 每個Die有2個子通道，每條子通道有12條資料訊號線(DQs)以最佳化通道性能 每條子通道會包含4個指令/地址(CA)訊號，可有效減少封裝時的接點錫球數輛並提高存取 資料速度 靜態效率模式下可支援更大容量的RAM配置，針對動態突發的資料長度可達32B或64B 支援動態寫入NT-ODT，使RAM能根據負載量調整ODT改善訊完整率 能源部分 LPDDR6會要求使用VDD2電力傳輸技術(且需要使用2組VDD2線路)，所需的電壓會比LPDDR5 還要更小。除此之外還包含 支援交替時脈命令輸入，以提高性能和效率 透過動態電壓頻率縮放(DVFSL)可讓LPDDR6在低速運行時可降低VDD2供電 動態效率模式下使用單一子通道介面(主要運用在低供耗和低頻寬環境) 支援自主更新和主動重新整理以減少重新整理時的供耗 安全性與可靠性 支援逐行啟動計數(PRAC)來確保DRAM的資料完整性 Carve-out Meta模式被定義為通過關鍵任務分配特定的記憶體區域以提高可靠性 支援可編碼鏈路保護以及ECC 支援命令/地址(CA)奇偶校驗、錯誤清除和內建自我測試(MBIST)以提升可靠性 至於顆粒製造商(三星、美光、海力士)對於LPDDR6的規範都表達正面支持的態度 -- 作者 KotoriCute (Lovelive!) 看板 PC_Shopping 標題 [情報] Skylake-X備貨捉急：居然不能如數交付 時間 Wed Jul 19 00:23:39 2017
推
07/19 00:32,
Intel跟AMD差別就在於利潤好幾萬還供不應求vs. 利潤
07/19 00:32
→
07/19 00:32,
微薄供不應求
07/19 00:32
推
07/19 00:35,
c52.exe是崩不應求
07/19 00:35
-- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 59.125.187.40 (臺灣) ※ 文章網址: https://www.ptt.cc/bbs/PC_Shopping/M.1752758092.A.C8B.html ※ 編輯: hn9480412 (59.125.187.40 臺灣), 07/17/2025 21:16:10
推
07/17 21:25, 5小時前 , 1F
反觀
07/17 21:25, 1F
推
07/17 21:48, 5小時前 , 2F
JEDEC不就300家企業組成 其中又那3家
07/17 21:48, 2F
→
07/17 21:48, 5小時前 , 3F
為主..
07/17 21:48, 3F
推
07/17 21:53, 5小時前 , 4F
LPDDR是行動裝置用的低功耗記憶體..PC
07/17 21:53, 4F
→
07/17 21:53, 5小時前 , 5F
很少會用
07/17 21:53, 5F
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07/17 22:08, 5小時前 , 6F
或Framework小主機那種
07/17 22:08, 6F
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07/17 22:10, 5小時前 , 7F
framework理念不會用無法更換的零件
07/17 22:10, 7F
→
07/17 22:11, 5小時前 , 8F
可替換就LPCAMM2了吧
07/17 22:11, 8F
→
07/17 22:57, 4小時前 , 9F
那個2024年講到現在的CAMM2在哪裡
07/17 22:57, 9F
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07/17 23:07, 4小時前 , 10F
等電腦版DDR6吧
07/17 23:07, 10F
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07/17 23:41, 3小時前 , 11F
感覺CAMM雷聲大雨點小
07/17 23:41, 11F
→
07/17 23:43, 3小時前 , 12F
21,000 MT/s 之前早就有說過
07/17 23:43, 12F
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07/17 23:44, 3小時前 , 13F
07/17 23:44, 13F
→
07/17 23:44, 3小時前 , 14F
兩邊已經相去不大
07/17 23:44, 14F
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07/17 23:45, 3小時前 , 15F
50%
07/17 23:45, 15F
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07/17 23:46, 3小時前 , 16F
還有HBM都沒玩家玩
07/17 23:46, 16F
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07/17 23:50, 3小時前 , 17F
For comparison, each channel of GDDR5 mem
07/17 23:50, 17F
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07/17 23:50, 3小時前 , 18F
ory is 32bit wide, and 16 channels are 51
07/17 23:50, 18F
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07/17 23:50, 3小時前 , 19F
2bit in total. In fact, the current mains
07/17 23:50, 19F
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07/17 23:51, 3小時前 , 20F
tream second-generation HBM2 can stack up
07/17 23:51, 20F
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07/17 23:51, 3小時前 , 21F
to 8 layers of DRAM die per stack, which
07/17 23:51, 21F
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07/17 23:51, 3小時前 , 22F
has improved capacity and speed.
07/17 23:51, 22F
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07/17 23:51, 3小時前 , 23F
07/17 23:51, 23F
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