[問題] Makefile variable in subdir
想請教關於Makefile中把variable傳入subdir的方式
關於export的部分我已經看過了，不過似乎沒辦法適用在我目前的狀況
我想實作的是像Kernel，經過config後，產生一個 .config 檔
然後整個Kernel source都會根據這個 .config 檔的variable進行判別編譯
例如 module 資料夾內容如下：
a d main.c Makefile config.mk
a folder: a1.c a2.c a3.c Makefile
Makefile(under a folder)的內容如下：
obj-$(CONFIG_A1) += a1.o
obj-$(CONFIG_A2) += a2.o
obj-$(CONFIG_A3) += a3.o
------------------------------------
d folder: d1.c d2.c d3.c d4.c Makefile
Makefile(under d folder)的內容如下：
obj-$(CONFIG_D1) += d1.o
obj-$(CONFIG_D2) += d2.o
obj-$(CONFIG_D3) += d3.o
obj-$(CONFIG_D4) += d4.o
------------------------------------
Makefile(under module folder)的內容如下：
KDIR ?= /lib/modules/$(shell uname -r)/build
PWD := $(shell pwd)
include /path/to/config.mk
obj-m := main.o
obj-y := a/ d/
all:
$(MAKE) -C $(KDIR) M=$(PWD)
clean:
$(MAKE) -C $(KDIR) M=$(PWD) clean
------------------------------------
config.mk的內容如下：
CONFIG_A1=y
CONFIG_A2=y
CONFIG_D1=y
CONFIG_D3=y
------------------------------------
在以上的情況下執行make，a和d folder的執行結果都不如預期
還望先進給予賜教，感謝
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很多人在即將失去的時候，不知他即將失去，最後他就真正失去 ▕天險▏
其實，一個不曾失去的人最可憐。因為，他永遠學不會什麼叫珍惜。▕刀藏▏
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